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版本 | 日期 | 作者 | 修改内容 |
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V1.0 | 2020-03-02 | gingko | 初次建立 |
/*************************************************/ //利用计数器实现一个定时器,定时为1s reg [31:0]time_cnt; always@(posedge clk_25m or negedge rst_n) begin if(!rst_n) begin time_cnt <= 32'd0; end else begin if(time_cnt==32'd24999999) begin time_cnt <= 32'd0;///计数器清零 end else begin time_cnt <= time_cnt + 1'd1;//计数器自加1 end end end wire time_sig = (time_cnt==32'd24999999) ? 1'd1 : 1'd0;//定时器信号