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版本 | 日期 | 作者 | 修改内容 |
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V1.0 | 2020-05-21 | gingko | 初次建立 |
其代码如下:
always@(posedge clk_25m or negedge rst_n) begin if(!rst_n) begin cycle_cnt <= 8'd0; pwm20_sig_r <= 1'd0; pwm50_sig_r <= 1'd0; end else begin if(cycle_cnt==cycle-1'd1)//计数器清零,步两个信号相位 begin cycle_cnt <= 8'd0; pwm20_sig_r <= 1'd1; pwm50_sig_r <= 1'd1; end else if(cycle_cnt==puty_50-1'd1)//变换占空比为50% begin pwm50_sig_r <= 1'd0; cycle_cnt <= cycle_cnt + 8'd1; end else if(cycle_cnt==puty_20-1'd1)//变换占空比为20% begin pwm20_sig_r <= 1'd0; cycle_cnt <= cycle_cnt + 8'd1; end else//计数器自加 begin cycle_cnt <= cycle_cnt + 8'd1; end end end